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Set up HDL verifier

조회 수: 1 (최근 30일)
Mohamed BAGHDADI
Mohamed BAGHDADI 2021년 1월 16일
답변: YP 2022년 11월 21일
how can i fix this problem?
PS: I work with MATLAB 2019b, Quartus Prime 18.1 & FPGA cyclone IV GX.

답변 (1개)

YP
YP 2022년 11월 21일
The command line window shows "Expected programming file not generated".
You may need to check the project log see why the bit file gen failed.

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