Bitwise Operator

입력에 대해 지정된 비트별 연산

라이브러리:
Simulink / Logic and Bit Operations
HDL Coder / Logic and Bit Operations

설명

Bitwise Operator 블록은 하나 이상의 피연산자에 대해 지정된 비트별 연산을 수행합니다. Logical Operator 블록의 논리 연산과 달리, 비트별 연산은 피연산자를 단일 값이 아니라 비트로 구성된 벡터로 처리합니다.

블록 연산에 대한 제한 사항

Bitwise Operator 블록은 시프트 연산을 지원하지 않습니다. 시프트 연산의 경우 Shift Arithmetic 블록을 사용하십시오.

다중 입력 XOR 게이트로 구성된 경우 이 블록은 IEEE^® Standard for Logic Elements에 따라 모듈로 2 덧셈 연산을 수행합니다.

예제

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Bitwise Operator 블록의 부호 없는 입력

모델 열기

다음 모델은 Bitwise Operator 블록이 부호 없는 입력에 대해 어떻게 작동하는지 보여줍니다.

각 Constant 블록은 부호 없는 8비트 정수(uint8)를 출력합니다. 각 Constant 블록 출력의 이진수 값을 확인하려면 dec2bin 함수를 사용하십시오. 다음 표에는 모든 논리 연산에 대한 결과가 나와 있습니다.

Bitwise Operator 블록의 부호 있는 입력

모델 열기

이 예제에서는 Bitwise Operator 블록이 부호 있는 입력에 대해 어떻게 작동하는지 보여줍니다.

각 Constant 블록은 부호 있는 8비트 정수(int8)를 생성합니다. 각 Constant 블록 출력의 이진수 값을 확인하려면 dec2bin 함수를 사용하십시오. 다음 표는 모든 논리 연산에 대한 결과를 보여줍니다.

포트

입력

모두 확장

Port_1 — 입력 신호
스칼라 | 벡터

입력 신호로, 스칼라 또는 벡터로 지정됩니다.

NOT 연산자는 하나의 입력만 허용하며 입력은 스칼라 또는 벡터일 수 있습니다. 입력이 벡터인 경우 출력은 입력 벡터 요소의 비트별 논리형 보수를 포함하는 같은 크기의 벡터입니다.
단일 벡터 입력의 경우 블록은 벡터의 모든 요소에 연산(NOT 연산자 제외)을 적용합니다.
둘 이상의 입력의 경우 블록은 모든 입력 간에 연산을 수행합니다. 입력이 벡터인 경우 블록은 벡터의 서로 대응하는 요소 간에 연산을 수행하여 벡터 출력을 생성합니다.

출력

모두 확장

Port_1 — 출력 신호
스칼라 | 벡터

출력 신호는 이 블록이 구동 블록에서 상속받은 출력 데이터형으로 지정되며, 정확히 0을 나타내야 합니다. 이 조건을 충족하는 데이터형에는 부호 있는 정수 데이터형과 부호 없는 정수 데이터형이 있습니다.

블록 출력의 크기는 입력 개수, 벡터 크기 및 선택한 연산자에 따라 달라집니다. 비트 마스크를 지정하지 않으면 출력은 스칼라입니다. 비트 마스크를 지정하면 출력은 벡터입니다.

파라미터

모두 확장

연산자 — 비트별 논리 연산자
AND (디폴트 값) | OR | NOR | NAND | XOR | NOT

블록 피연산자에 대한 비트별 논리 연산자를 지정합니다.

다음과 같은 비트별 연산 중 하나를 선택할 수 있습니다.

비트별 연산	설명
AND	대응하는 비트가 모두 TRUE이면 TRUE
OR	대응하는 비트 중 적어도 하나가 TRUE이면 TRUE
NAND	대응하는 비트 중 적어도 하나가 FALSE이면 TRUE
NOR	대응하는 비트 중 TRUE가 없으면 TRUE
XOR	TRUE인 대응하는 비트의 개수가 홀수이면 TRUE
NOT	입력값이 FALSE이면 TRUE(단일 입력값에만 사용할 수 있음)

프로그래밍 방식의 사용법

블록 파라미터: logicop

유형: 문자형 벡터

값: 'AND'|'OR' |'NAND'|'NOR' |'XOR' | 'NOT'

디폴트 값: 'AND'

비트 마스크 사용 — 비트 마스크 사용 여부 선택
선택됨 (디폴트 값) | 선택 해제됨

비트 마스크 사용 여부를 선택합니다. 이 체크박스를 선택 해제하면 입력 포트 개수가 활성화되고 비트 마스크와 마스크를 다음으로 취급이 비활성화됩니다.

프로그래밍 방식의 사용법

블록 파라미터: UseBitMask

유형: 문자형 벡터

값: 'off'|'on'

디폴트 값: 'on'

입력 포트 개수 — 입력 신호 개수
1 (디폴트 값) | 정수

입력 개수를 지정합니다. 둘 이상의 입력 포트를 가질 수 있습니다.

종속성

비트 마스크 사용 체크박스를 선택 해제하면 입력 포트 개수가 활성화되고 비트 마스크와 마스크를 다음으로 취급이 비활성화됩니다.

프로그래밍 방식의 사용법

블록 파라미터: NumInputPorts

유형: 문자형 벡터

값: 양의 정수

디폴트 값: '1'

비트 마스크 — 단일 입력에 연결할 비트 마스크
bin2dec (디폴트 값)

단일 입력에 연결할 비트 마스크를 지정합니다. 이 파라미터는 값을 16진수 값으로 읽습니다.

비트 마스크를 사용하여 입력값의 비트를 설정하거나(set) 가져오거나(get) 지울 수 있습니다(clear).

수행하는 작업	연산자 파라미터 설정	비트 마스크 생성
비트 설정(set)	OR	대응하는 각 입력 비트를 1로 설정하려면 1로 된 비트 마스크 생성
비트 지우기(clear)	AND	대응하는 각 입력 비트를 0으로 설정하려면 0으로 된 비트 마스크 생성
비트 가져오기(get)	AND	대응하는 각 입력 비트를 가져오려면 1로 된 비트 마스크 생성

8비트 입력 벡터의 네 번째 비트를 설정한다고 가정하겠습니다. 비트 마스크는 00010000이며, 비트 마스크 파라미터에 2^4로 지정할 수 있습니다. 비트를 지우려면 비트 마스크는 11101111이 되며, 비트 마스크 파라미터에 2^7+2^6+2^5+2^3+2^2+2^1+2^0으로 지정할 수 있습니다.

팁

53비트보다 큰 마스크를 사용하지 마십시오. 사용할 경우 시뮬레이션 중에 오류 메시지가 표시됩니다.

종속성

이 파라미터는 비트 마스크 사용을 선택한 경우에만 사용할 수 있습니다.

프로그래밍 방식의 사용법

블록 파라미터: BitMask

유형: 문자형 벡터

값: 양의 정수

디폴트 값: 'bin2dec('11011001')'

마스크를 다음으로 취급 — 마스크를 실제 값 또는 저장된 정수로 취급
`저장된 정수` (디폴트 값) | `실제 값`

마스크를 실제 값으로 취급할지 아니면 저장된 정수로 취급할지 지정합니다.

인코딩 체계는 V = SQ + B입니다(Fixed-Point Designer™ 문서의 스케일링 (Fixed-Point Designer) 항목 참조). 실제 값은 마스크를 V로 취급합니다. 저장된 정수는 마스크를 Q로 취급합니다.

종속성

이 파라미터는 비트 마스크 사용을 선택한 경우에만 사용할 수 있습니다.

프로그래밍 방식의 사용법

블록 파라미터: BitMaskRealWorld

유형: 문자형 벡터

값: 'Real World Value' | 'Stored Integer'

디폴트 값: 'Stored Integer'

블록 특성

데이터형	`Boolean^a` \| `fixed point` \| `integer`
직접 피드스루	`아니요`
다차원 신호	`예`
가변 크기 신호	`아니요`
영점교차 검출	`아니요`
^a 부울형 신호에 비트 연산을 사용하는 것은 권장되지 않습니다.

확장 기능

모두 확장

C/C++ 코드 생성
Simulink® Coder™를 사용하여 C 코드나 C++ 코드를 생성할 수 있습니다.

HDL 코드 생성
HDL Coder™를 사용하여 FPGA 및 ASIC 설계를 위한 VHDL, Verilog 및 SystemVerilog 코드를 생성할 수 있습니다.

HDL Coder™는 HDL 구현과 합성된 논리에 영향을 주는 추가 구성 옵션을 제공합니다.

HDL 아키텍처

이 블록에는 하나의 디폴트 HDL 아키텍처가 있습니다.

HDL 블록 속성

ConstrainedOutputPipeline	기존 지연을 설계 내부로 이동하여 출력에 배치하는 레지스터 개수입니다. 분산된 파이프라이닝은 이러한 레지스터를 다시 분산하지 않습니다. 디폴트 값은 `0`입니다. 자세한 내용은 ConstrainedOutputPipeline (HDL Coder) 항목을 참조하십시오.
InputPipeline	생성된 코드에 삽입할 입력 파이프라인 단계의 개수입니다. 분산 파이프라이닝과 제약이 있는 출력 파이프라이닝은 이러한 레지스터를 이동할 수 있습니다. 디폴트 값은 `0`입니다. 자세한 내용은 InputPipeline (HDL Coder) 항목을 참조하십시오.
OutputPipeline	생성된 코드에 삽입할 출력 파이프라인 단계의 개수입니다. 분산 파이프라이닝과 제약이 있는 출력 파이프라이닝은 이러한 레지스터를 이동할 수 있습니다. 디폴트 값은 `0`입니다. 자세한 내용은 OutputPipeline (HDL Coder) 항목을 참조하십시오.

PLC 코드 생성
Simulink® PLC Coder™를 사용하여 Structured Text 코드를 생성할 수 있습니다.

고정소수점 변환
Fixed-Point Designer™를 사용하여 고정소수점 시스템을 설계하고 시뮬레이션할 수 있습니다.

버전 내역

R2006a 이전에 개발됨

참고 항목

Logical Operator | Compare To Constant | Compare To Zero | Shift Arithmetic

도움말 항목

WWV Digital Receiver - Synchronization and Detection (DSP System Toolbox)

Bitwise Operator

설명

블록 연산에 대한 제한 사항

예제

Bitwise Operator 블록의 부호 없는 입력

Bitwise Operator 블록의 부호 있는 입력

포트

입력

Port_1 — 입력 신호 스칼라 | 벡터

출력

Port_1 — 출력 신호 스칼라 | 벡터

파라미터

연산자 — 비트별 논리 연산자 AND (디폴트 값) | OR | NOR | NAND | XOR | NOT

프로그래밍 방식의 사용법

비트 마스크 사용 — 비트 마스크 사용 여부 선택 선택됨 (디폴트 값) | 선택 해제됨

프로그래밍 방식의 사용법

입력 포트 개수 — 입력 신호 개수 1 (디폴트 값) | 정수

종속성

프로그래밍 방식의 사용법

비트 마스크 — 단일 입력에 연결할 비트 마스크 bin2dec (디폴트 값)

종속성

프로그래밍 방식의 사용법

마스크를 다음으로 취급 — 마스크를 실제 값 또는 저장된 정수로 취급 저장된 정수 (디폴트 값) | 실제 값

종속성

프로그래밍 방식의 사용법

블록 특성

확장 기능

C/C++ 코드 생성 Simulink® Coder™를 사용하여 C 코드나 C++ 코드를 생성할 수 있습니다.

HDL 코드 생성 HDL Coder™를 사용하여 FPGA 및 ASIC 설계를 위한 VHDL, Verilog 및 SystemVerilog 코드를 생성할 수 있습니다.

PLC 코드 생성 Simulink® PLC Coder™를 사용하여 Structured Text 코드를 생성할 수 있습니다.

고정소수점 변환 Fixed-Point Designer™를 사용하여 고정소수점 시스템을 설계하고 시뮬레이션할 수 있습니다.

버전 내역

참고 항목

도움말 항목

Port_1 — 입력 신호
스칼라 | 벡터

Port_1 — 출력 신호
스칼라 | 벡터

연산자 — 비트별 논리 연산자
AND (디폴트 값) | OR | NOR | NAND | XOR | NOT

비트 마스크 사용 — 비트 마스크 사용 여부 선택
선택됨 (디폴트 값) | 선택 해제됨

입력 포트 개수 — 입력 신호 개수
1 (디폴트 값) | 정수

비트 마스크 — 단일 입력에 연결할 비트 마스크
bin2dec (디폴트 값)

마스크를 다음으로 취급 — 마스크를 실제 값 또는 저장된 정수로 취급
`저장된 정수` (디폴트 값) | `실제 값`

C/C++ 코드 생성
Simulink® Coder™를 사용하여 C 코드나 C++ 코드를 생성할 수 있습니다.

HDL 코드 생성
HDL Coder™를 사용하여 FPGA 및 ASIC 설계를 위한 VHDL, Verilog 및 SystemVerilog 코드를 생성할 수 있습니다.

PLC 코드 생성
Simulink® PLC Coder™를 사용하여 Structured Text 코드를 생성할 수 있습니다.

고정소수점 변환
Fixed-Point Designer™를 사용하여 고정소수점 시스템을 설계하고 시뮬레이션할 수 있습니다.