Bit Set
저장된 정수의 지정된 비트를 1로 설정
![](bit_set_block_icon.png)
라이브러리:
Simulink /
Logic and Bit Operations
HDL Coder /
Logic and Bit Operations
설명
Bit Set 블록은 저장된 정수의 지정된 비트를 1로 설정합니다. 스케일링은 무시됩니다.
비트 인덱스 파라미터를 사용하여 1로 설정할 비트를 지정할 수 있습니다. 여기서 비트 0이 최하위 비트입니다.
예제
Bit Set 블록 사용하기
비트 2에 대해 Bit Set 블록이 켜져 있는 경우 비트 2는 1로 설정됩니다.
상수 2.^[0 1 2 3 4]로 구성된 벡터는 이진수로는 [00001 00010 00100 01000 10000]으로 표현됩니다.
비트 2가 1로 설정된 경우 결과는 [00101 00110 00100 01100 10100]이며, 10진수로는 [5 6 4 12 20]으로 표현됩니다.
포트
입력
Port_1 — 입력 신호
스칼라 또는 벡터
저장된 정수의 지정된 비트를 가진 입력 신호입니다.
데이터형: single
| double
| Boolean
| fixed point
출력
Port_1 — 출력 신호
스칼라 또는 벡터
지정된 비트가 1로 설정된 출력 신호입니다.
데이터형: single
| double
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
| Boolean
| fixed point
| enumerated
| bus
파라미터
비트 인덱스 — 비트 인덱스
0 (디폴트 값) | 스칼라 또는 벡터
비트 0이 최하위 비트인 비트 인덱스
프로그래밍 방식의 사용법
블록 파라미터: iBit |
유형: 문자형 벡터 |
값: 양의 정수 |
디폴트 값: '0' |
블록 특성
확장 기능
C/C++ 코드 생성
Simulink® Coder™를 사용하여 C 코드나 C++ 코드를 생성할 수 있습니다.
HDL 코드 생성
HDL Coder™를 사용하여 FPGA 및 ASIC 설계를 위한 VHDL, Verilog 및 SystemVerilog 코드를 생성할 수 있습니다.
HDL Coder™는 HDL 구현과 합성된 논리에 영향을 주는 추가 구성 옵션을 제공합니다.
이 블록에는 하나의 디폴트 HDL 아키텍처가 있습니다.
ConstrainedOutputPipeline | 기존 지연을 설계 내부로 이동하여 출력에 배치하는 레지스터 개수입니다. 분산된 파이프라이닝은 이러한 레지스터를 다시 분산하지 않습니다. 디폴트 값은 |
InputPipeline | 생성된 코드에 삽입할 입력 파이프라인 단계의 개수입니다. 분산 파이프라이닝과 제약이 있는 출력 파이프라이닝은 이러한 레지스터를 이동할 수 있습니다. 디폴트 값은 |
OutputPipeline | 생성된 코드에 삽입할 출력 파이프라인 단계의 개수입니다. 분산 파이프라이닝과 제약이 있는 출력 파이프라이닝은 이러한 레지스터를 이동할 수 있습니다. 디폴트 값은 |
PLC 코드 생성
Simulink® PLC Coder™를 사용하여 Structured Text 코드를 생성할 수 있습니다.
고정소수점 변환
Fixed-Point Designer™를 사용하여 고정소수점 시스템을 설계하고 시뮬레이션할 수 있습니다.
버전 내역
R2006a 이전에 개발됨
참고 항목
Bit Clear | Bitwise Operator | Bit Rotate (HDL Coder) | Bit Shift (HDL Coder)
MATLAB 명령
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