이 번역 페이지는 최신 내용을 담고 있지 않습니다. 최신 내용을 영문으로 보려면 여기를 클릭하십시오.
Complex to Real-Imag
복소 입력 신호의 실수부와 허수부 출력
라이브러리:
Simulink /
Math Operations
HDL Coder /
Math Operations
설명
Complex to Real-Imag 블록은 입력 신호의 실수부 및/또는 허수부를 출력 파라미터 설정에 따라 출력합니다. 실수 출력은 복소수 입력과 동일한 데이터형입니다. 입력은 복소 신호로 구성된 배열(벡터 또는 행렬)이 될 수 있으며, 이 경우 출력 신호는 동일한 차원의 배열입니다. 실수 배열에는 대응하는 복소수 입력 요소의 실수부가 포함됩니다. 마찬가지로 허수 출력에는 입력 요소의 허수부가 포함됩니다.
예제
유계 가변 크기 신호의 기본 연산
이 예제에서는 유계 가변 크기 신호를 생성하는 방법을 보여주고 이러한 신호를 사용하는 일부 연산을 보여줍니다. 이 예제에서는 Selector 블록과 Switch 블록을 사용하여 가변 크기 신호를 생성합니다. 이 신호는 수학 연산, 버스 생성, 버스 선택, 행렬 결합 및 이산 필터 방정식 구현에 사용됩니다.
Measure Frequency Response by Using Complex Data in Stateflow
Emulate a spectrum analyzer that measures the frequency response of a continuous-time system driven by a complex sinusoidal signal.
(Stateflow)
포트
입력
Port_1 — 입력 신호
스칼라 | 벡터 | 행렬
블록이 계산하는 복소 입력 신호로, 계산 결과로 실수부 및/또는 허수부를 출력합니다.
데이터형: single
| double
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
| Boolean
| fixed point
출력
Port_1 — 출력 신호
스칼라 | 벡터 | 행렬
입력 신호의 실수부 및/또는 허수부인 출력 신호입니다. 어느 부분을 출력할지 선택하려면 출력 파라미터를 설정하십시오.
데이터형: single
| double
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
| Boolean
| fixed point
파라미터
출력 — 실수 및/또는 허수 출력 지정
실수와 허수
(디폴트 값) | 실수
| 허수
출력값이 입력 신호의 실수부인지, 허수부인지 또는 실수부와 허수부 모두인지 여부를 지정합니다.
프로그래밍 방식의 사용법
파라미터: Output
|
유형: string형 | 문자형 벡터 |
값: 'Real and imag' | 'Real' | 'Imag' |
디폴트 값: 'Real and imag'
|
샘플 시간(상속된 경우 -1) — 샘플 간의 간격
-1
(디폴트 값) | 스칼라 | 벡터
샘플 간의 시간 간격을 지정합니다. 샘플 시간을 상속하려면 이 파라미터를 -1
로 설정하십시오. 자세한 내용은 샘플 시간 지정하기 항목을 참조하십시오.
종속성
이 파라미터는 -1
이외의 값으로 설정한 경우에만 표시됩니다. 자세한 내용은 Blocks for Which Sample Time Is Not Recommended 항목을 참조하십시오.
프로그래밍 방식의 사용법
블록 파라미터: SampleTime |
유형: string형 스칼라 또는 문자형 벡터 |
디폴트 값: "-1" |
블록 특성
데이터형 |
|
직접 피드스루 |
|
다차원 신호 |
|
가변 크기 신호 |
|
영점교차 검출 |
|
확장 기능
C/C++ 코드 생성
Simulink® Coder™를 사용하여 C 코드나 C++ 코드를 생성할 수 있습니다.
HDL 코드 생성
HDL Coder™를 사용하여 FPGA 및 ASIC 설계를 위한 VHDL, Verilog 및 SystemVerilog 코드를 생성할 수 있습니다.
HDL Coder™는 HDL 구현과 합성된 논리에 영향을 주는 추가 구성 옵션을 제공합니다.
이 블록에는 하나의 디폴트 HDL 아키텍처가 있습니다.
ConstrainedOutputPipeline | 기존 지연을 설계 내부로 이동하여 출력에 배치하는 레지스터 개수입니다. 분산된 파이프라이닝은 이러한 레지스터를 다시 분산하지 않습니다. 디폴트 값은 |
InputPipeline | 생성된 코드에 삽입할 입력 파이프라인 단계의 개수입니다. 분산 파이프라이닝과 제약이 있는 출력 파이프라이닝은 이러한 레지스터를 이동할 수 있습니다. 디폴트 값은 |
OutputPipeline | 생성된 코드에 삽입할 출력 파이프라인 단계의 개수입니다. 분산 파이프라이닝과 제약이 있는 출력 파이프라이닝은 이러한 레지스터를 이동할 수 있습니다. 디폴트 값은 |
이 블록은 복소 신호를 위한 코드 생성을 지원합니다.
고정소수점 변환
Fixed-Point Designer™를 사용하여 고정소수점 시스템을 설계하고 시뮬레이션할 수 있습니다.
버전 내역
R2006a 이전에 개발됨
MATLAB 명령
다음 MATLAB 명령에 해당하는 링크를 클릭했습니다.
명령을 실행하려면 MATLAB 명령 창에 입력하십시오. 웹 브라우저는 MATLAB 명령을 지원하지 않습니다.
Select a Web Site
Choose a web site to get translated content where available and see local events and offers. Based on your location, we recommend that you select: .
You can also select a web site from the following list:
How to Get Best Site Performance
Select the China site (in Chinese or English) for best site performance. Other MathWorks country sites are not optimized for visits from your location.
Americas
- América Latina (Español)
- Canada (English)
- United States (English)
Europe
- Belgium (English)
- Denmark (English)
- Deutschland (Deutsch)
- España (Español)
- Finland (English)
- France (Français)
- Ireland (English)
- Italia (Italiano)
- Luxembourg (English)
- Netherlands (English)
- Norway (English)
- Österreich (Deutsch)
- Portugal (English)
- Sweden (English)
- Switzerland
- United Kingdom (English)