bitsrl
비트를 오른쪽으로 논리 시프트
설명
예제
부호 있는 fi 입력값을 오른쪽으로 시프트하기
부호 있는 fi
입력값을 오른쪽으로 1비트 시프트합니다.
값이 -8이고 워드 길이가 4이고 소수부 길이가 0인 부호 있는 고정소수점 fi
객체를 만들고, 해당 이진수 값을 표시합니다.
a = fi(-8,1,4,0); disp(bin(a))
1000
a
를 오른쪽으로 1비트 시프트하고, 해당 이진수 값을 표시합니다.
disp(bin(bitsrl(a,1)))
0100
bitsrl
은 오른쪽 시프트한 비트 위치에 0을 시프트합니다.
fi 시프트 값을 사용하여 오른쪽 시프트하기
fi
시프트 값을 사용하여 내장 int8
형 입력값을 오른쪽으로 시프트합니다.
k = fi(2); a = int8(64); bitsrl(a,k)
ans = int8
16
내장 uint8형 입력값을 오른쪽으로 시프트하기
입력 인수
a
— 시프트할 데이터
스칼라 | 벡터 | 행렬 | 다차원 배열
시프트할 데이터로, 스칼라, 벡터, 행렬 또는 다차원 배열로 지정됩니다.
데이터형: fi
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
복소수 지원: 예
k
— 시프트할 비트 수
음이 아닌 정수 값 스칼라
시프트할 비트 수로, 음이 아닌 정수 값 스칼라로 지정됩니다.
데이터형: fi
|single
| double
| int8
| int16
| int32
| int64
| uint8
| uint16
| uint32
| uint64
확장 기능
C/C++ 코드 생성
MATLAB® Coder™를 사용하여 C 코드나 C++ 코드를 생성할 수 있습니다.
사용법 관련 참고 및 제한 사항:
범위를 벗어난 시프트는 생성 코드에서 처리되지 않을 수 있습니다.
GPU 코드 생성
GPU Coder™를 사용하여 NVIDIA® GPU용 CUDA® 코드를 생성할 수 있습니다.
사용법 관련 참고 및 제한 사항:
범위를 벗어난 시프트는 생성 코드에서 처리되지 않을 수 있습니다.
HDL 코드 생성
HDL Coder™를 사용하여 FPGA 및 ASIC 설계를 위한 VHDL, Verilog 및 SystemVerilog 코드를 생성할 수 있습니다.
VHDL®에서는 srl
연산자를 생성합니다.
Verilog®에서는 >>
연산자를 생성합니다.
버전 내역
R2007b에 개발됨
MATLAB 명령
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